Famiglia Marvell Armada 38X 88f6828b0-BRT4kit sistema CPU doppio ad alte prestazioni attivo Chip

Model No.
88F6828B0-BRT4KIT
Pacchetto di Trasporto
Tray
Specifiche
TFBGA 17x17 mm package, 0.8 mm ball pitch
Marchio
Marvell ARMADA
Origine
Original
Codice SA
8542390000
Prezzo di riferimento
$ 37.08 - 41.22
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Descrizione del Prodotto

Sistema a doppia CPU ad alte prestazioni della famiglia Marvell ARMADA 38x 88F6828B0-BRT4KIT attivato Chip

La  scheda tecnica o le specifiche funzionali di 88F6810, 88F6811, 88F6821, 88F6W21, 88F6820, E 88F6828 LA famiglia ARMADA 38x System on chip ad alte prestazioni con CPU singola/doppia ha 1432 pagine e il file PDF è di dimensioni pari a 161 MB. Per informazioni, contattare:
 
 
 
 
 
 
 

Elenco dettagliato delle funzioni

CPU Cortex-A9 ARMv7
Il core ARMv7 supporta le seguenti funzioni:
•   88F6810/88F6820/88F6828 -fino a 1.866 GHz
•   88F6811/88F6821 -clock CPU fino a 1.33 GHz
•   88F6W21 -clock CPU fino a 1.2 GHz
CPU   RISC superscalare con architettura Harvard, lunghezza variabile, pipeline fuori servizio. •
•   coprocessore SIMD NEON per una migliore elaborazione del segnale
•   istruzioni DSP per migliorare le prestazioni multimediali e del segnale algoritmi di elaborazione
•   set di istruzioni a 32 bit per prestazioni elevate e flessibilità
•   Set di istruzioni Thumb-2 e Thumb-EE per la densità del codice
•    unità a virgola mobile di precisione singola/doppia (FPU)
•   modalità SMP (Symmetric Multiprocessing) e AMP (Asymmetric Multiprocessing)
•   32 KB L1 cache istruzioni a 4 vie, set-associative, virtualmente indicizzate, fisicamente contrassegnate, con protezione di parità
•   32 KB di cache dati L1, 4 vie, associativa, fisicamente indicizzata, fisicamente codificata, protezione parità
•   L1 precaricamento:
    --  azionamento software mediante istruzioni ARM PLD
    --  Prefetcher hardware che monitora fino a 2 flussi di dati
•   buffer di ricerca avanti della tabella (TLB):
    --  Micro TLB: Due a 64 voci completamente associative per le cache di istruzioni e dati
    --  Macro TLB: Struttura associativa a 2 vie a 512 voci
•   Schema di coerenza cache MESI
•   hit-under-miss e più richieste in sospeso
•   tubazione a 8 stadi
•   esecuzione fuori ordine per prestazioni superiori
•   unità di previsione filiale:
    --  BTAC (Branch Target Address cache) a 2 vie con 4096 voci
    --  buffer Global History (GHB) con predittori a 2 bit 16K
    --  Restituisci stack con otto voci a 32 bit
  64 bus dati interno a 64 bit con carico/ memorizzazione a • bit istruzioni
•   Endianess options-little or Mixed Endian
•   unità di monitoraggio delle prestazioni (PMU) che conta fino a 6 unità  tipi di evento
•   JTAG/ARM compatibile ICE e modulo di traccia incorporato (ETM) per funzioni avanzate   funzionalità di debug in tempo reale

 Cache di livello 2 unificata
•   1024 vie, 16 KB, cache write-back e write-through
•   fisicamente indicizzati con tag (PIPT)
•   la pipeline non bloccante supporta più richieste in sospeso e viene sottoposta a un hit under Funzionamento Miss(HUM)
•   blocco/blocco delle vie per dati e istruzioni per linea o master ID
•   protezione parità

  CONTROLLER SDRAM DDR3/DDR3L/DDR4
•   16/32 bit, con un'opzione ECC (Error Correcting Code) supportata da entrambe   le larghezze dell'interfaccia
•   88F6810/88F6820/88F6828 -SUPPORTA DDR3/DDR3L-1600/1866 E DDR4-1800
•   88F6811/88F6821 -SUPPORTA DDR3/DDR3L-1333
•   88F6W21 -SUPPORTA DDR3/DDR3L-1200
•   supporta un rapporto di clock sincrono di 1:N e 2:N tra I core della CPU e   l'interfaccia DRAM
•   supporta frequenze di clock asincrone tra i core della CPU e.   L'interfaccia DRAM
•   supporta 1.5 e 1,35 V per DDR3 (SSTL) e 1,2 V. Per DDR4 (POD1)
•   Smart Scheduler per riordinare le transazioni e QoS
•   Calibrazione automatica dell'impedenza di uscita i/O.
•   fino a 8 GB per DDR3 e 16 GB per DDR4 (supporta tutte le densità dei dispositivi DDR   , in conformità allo standard JEDEC)
•   supporto per il livellamento in scrittura e lettura DDR3/DDR4
•   dati proprietari e controllo del processo di ottimizzazione del pattern degli occhi a. migliorare   l'integrità del segnale
•   supporto del mirroring degli indirizzi DDR3
•   SUPPORTA DDR3/DDR4 BL8
•   supporta le modalità 2T e 3T per abilitare l'alta frequenza funzionamento anche in   configurazione con carico pesante
•   supporta l'interlacciamento di banchi SDRAM
•   8/16 pagine aperte per rango (DDR3 e DDR4, rispettivamente)
•    fino a un burst di 128 byte per singola memoria
•   supporta dispositivi di memoria x8 e x16
•   supporta le seguenti caratteristiche DDR4:
    --  PDA DDR4 (per accessibilità DRAM)
    --  lettura della DDR4 MRS
    --  DDR4 diversi tempi di gruppi bancari
    --  supporta diverse mappature dei pin per l'ottimizzazione DDR3/DDR4 del routing della scheda

Porte Gigabit Ethernet (GbE)
•   88F6810
    --  2 porte GbE (0 e 1)
    --    INTERFACCIA SGMII / RGMII / MII
•   88F6820/88F6828
    --  3 porte GbE (0-2)
    --     INTERFACCIA SGMII / QSGMII / RGMII / MII
•   88F6811/88F6821/88F6W21
    --  2 porte GbE (0 e 1)
    --    INTERFACCIA SGMII / RGMII / MII
•   SGMII supporta 10/100/1000/2500 Mbps
•   velocità di ricezione e trasmissione full-wire di pacchetti brevi
•   supporto per IEEE 1588v2 (PTP)
•   filtro da
     
•   arbitraggio prioritario/WRR rigoroso tra 8 code di trasmissione con velocità limitazione
•   per la configurazione della velocità di uscita della coda
•   supporto per la messa in coda in base al tag DSA Marvell®
•   supporto per jumbo frame (fino a 10K) sia in ricezione che in trasmissione
•   accelerazione checksum TCP/IP
•   supporto per IEEE 802.3az (Ethernet a risparmio energetico)
•   supporto per Wake-on-LAN

Gestione buffer hardware
•   4 pool di buffer indipendenti
•   fino a 64 KB di elementi per pool
•   motori DMA dedicati per la lettura anticipata o la scrittura da/verso esterno memoria

Interfaccia PCI Express (PCIe)
•   88F6810/88F6811/88F6821 -supporta 3 porte x1 corsie
•   88F6W21 -supporta 2 porte x1 corsie
•   88F6820/88F6828 -supporta 1 porta x4 corsie e 2 porte aggiuntive 1 corsia o   fino a 4 porte x1 corsia
•   PCIe Gen 1.1 a 2.5 Gbps/ Gen 2.0  Segnalazione a 5 Gbps
•   supporta le modalità Root Complex e Endpoint
•   supporto inversione/inversione polarità corsia
•   dimensione massima del carico utile di 128 byte
•   canale virtuale singolo (VC-0)
•   supporto del buffer di riproduzione
•   spazio di configurazione PCIe esteso
•   Gestione alimentazione: Supporto stato di alimentazione attivo L0s e L1 ASPM;   supporto software L1 e L2
     
•   supporto messaggi di errore
•   caratteristiche specifiche del master PCIe:
    --  Bridge da host a PCIe: Traduce i cicli della CPU nella memoria PCIe o nei cicli di configurazione
    --  supporta burst DMA tra memoria e PCIe
    --  supporta fino a 4 transazioni in lettura in sospeso
    --  richiesta di lettura massima fino a 128 byte
•   caratteristiche specifiche della destinazione PCIe:
    --  supporta la ricezione di un massimo di 8 richieste di lettura
    --  richiesta di lettura massima fino a 4 KB
    --  supporta l'accesso PCIe allo spazio interno ed esterno del dispositivo

Corsie SERDES integrate ad alta velocità
•   88F6810 -integra 5 PHY SERDES a bassa potenza e ad alta velocità, basati sulla   comprovata tecnologia Marvell SERDES
•   88F6811/88F6821/88F6W21 -integra 4 PHY SERDES a bassa potenza e ad alta velocità   , basati sulla comprovata tecnologia Marvell SERDES
•   88F6820/88F6828 -integra 6 PHY SERDES a bassa potenza e ad alta velocità, basati sulla   comprovata tecnologia Marvell SERDES
•   diverse opzioni di multiplazione delle   interfacce PCIe, SATA 3.0, SGMII, QSGMII e USB 3.0

Controller USB
•   88F6810/88F6820/88F6828 -3 porte USB configurabili dai seguenti 4 controller USB:
    2  porte USB 3.0/2.0 compatibili con host con PHY integrati
    --  1 porta compatibile con dispositivi USB 3.0 con PHY integrati
    --  1 porta USB 2.0 compatibile con host o dispositivo con PHY integrato
•   88F6811/88F6821 -2 porte USB configurabili dai seguenti 3 controller USB:
    2  porte USB 3.0/2.0 compatibili con host con PHY integrati
    -- porta USB 3.0 compatibile 88F6811/88F6821-1 con PHY integrati
•    come host:
    --  compatibile con l'interfaccia controller host estensibile (xHCI)
    --  supporta il collegamento diretto a tutti i tipi di dispositivi (SS, HS, FS, LS)
    --  supporta fino a 64/16 endpoint indipendenti (USB 3.0/USB 2.0, rispettivamente)
•   come dispositivo:
    --  si collega a tutti i tipi di host (SS, HS, FS) e hub
    --  supporta fino a 16/4 endpoint indipendenti (USB 3.0/USB 2.0, rispettivamente)
•   supporta il trasferimento di dati di controllo, interrupt, bulk e isocrono
•   stati di gestione dell'alimentazione USB:
    --  U0 (attivo), U1 (inattivo), U2 (regime di minimo a vuoto) e U3 (sospeso) per USB 3.0
    --  Sospendi e Riprendi per USB 2.0

2   porte SATA 3.0 Marvell® 6 Gbps (Gen 3)
•   88F6810/88F6820 -2 porte SATA 3.0 completamente compatibili
•   88F6828 -4 porte SATA 3.0 completamente compatibili
•   88F6811/88F6821 -2 porte SATA 3.0 completamente compatibili
•   88F6W21 -1 porta SATA 3.0 completamente compatibile
•   supporta velocità di comunicazione di 6.0 Gbps, 3.0 Gbps e 1.5 Gbps
•   supporta Gen 1x, Gen 2x, Gen 3
•   supporta livelli di segnale del trasmettitore programmabili
•   supporta Native Command Queuing (NCQ) e DMA di prima parte (FPDAM) con fino   a 32 comandi in sospeso per porta
•   supporta interfacce di programmazione AHCI 1.0 e IDE
•   supporta il moltiplicatore di porta (PM): Esegue la commutazione basata su FIS come definito nella   Definizione PM del gruppo di lavoro SATA
•   selettore di porta (PS): Consente di eseguire la sequenza OOB (out-of-Band) basata sul protocollo   selezionare la porta host attiva
•   supporta SATA esterno (eSATA)
•   supporta gli stati di gestione dell'alimentazione parziale e Slumber
•   coalescenza di interrupt avanzata
•   Diagnostica avanzata della guida tramite il comando ATA SMART

2 motori di crittografia
•   implementazione hardware sui motori di crittografia/decrittografia e autenticazione per   aumentare Protezione IP (IPsec) e crittografia/decrittografia dei file
•   DMA dedicato per alimentare i dati al motore hardware Dalla   memoria SRAM interna o dalla memoria DDR
•   implementa algoritmi di crittografia AES, DES e 3DES
•   implementa gli algoritmi di autenticazione SHA2, SHA1 e MD5

4 motori XOR DMA
•   RAID5 P (PARITÀ XOR) generare e riparare fino a 8 blocchi sorgente
•   RAID6 P e Q generano e riparano fino a. 8 blocchi sorgente
•   accelerazione della copia della memoria (DMA)
•   calcolo iSCSI CRC-32
•   funzione di inizializzazione della memoria

Controller TDM
•   supporta 2 canali VoIP indipendenti
•   interfaccia generica per SLIC / SLAC / DAA standard / dispositivi codec
•   compatibile con i formati autostradali PCM standard
•   supporta varie velocità di clock di bit (da 256 kHz a 8.192 MHz, con incrementi di   potenza di 2)

Interfacce audio di ingresso/uscita I2S e uscita S/PDIF
•   velocità di campionamento di 44.1, 48 e 96 kHz
•   conforme alle specifiche IEC 60958-1, 60958-3 e 61937
•   supporta formati semplici I2S, giustificati a destra e a sinistra

Controller bus dispositivo
•    bus dati / indirizzi multiplex a 8/16 bit
•   supporta diversi tipi di dispositivi di memoria standard, come FLASH E   ROM
•    fino a 5 chip selezionati con temporizzazione programmabile

Controller flash NAND
•   supporto nativo per NAND Flash con fino a:
    --  dimensione pagina 8 KB
    -  - ECC a 16 bit per pagina
•   4 chip selezionati con temporizzazione programmabile e opzionale esterno controllo stato di attesa

2 porte SPI
•   interfaccia SPI a 1 bit per impieghi generali
•   la porta SPI dispone di un massimo di 4 chip selezionati

Interfaccia   host SD / SDIO / MMC / eMMC
•    1 bit / 4 bit SDmem, SDIO 3.0
•     MMC 4.4 a 1 bit / 4 bit / 8 bit per eMMC
•   SDR-50: Fino a 100 MHz
•   HS-DDR: Fino a 50 MHz
•   hardware genera/controlla CRC su tutte le transazioni di dati e comandi sul bus della carta  

2 interfacce UART
•   16750 compatibile con UART
•   ogni porta ha:
--  2 pin per le operazioni di trasmissione e ricezione
--  2 pin per le funzioni di controllo del modem

Gestione avanzata dell'alimentazione
•   stati di gestione dell'alimentazione della CPU:
    --  Deep Idle (spegnimento CPU)
    --  inattivo (sincronizzazione clock CPU)
    -  - acceleratore (velocità ridotta CPU)
    -  - esecuzione (CPU a piena velocità)
•   Standby con allarme RTC (Real Time Clock) o esterno opzioni di sveglia
•   Wake-on-LAN (WOL) con ricezione dei pacchetti senza perdita di dati
•   modalità di aggiornamento automatico e spegnimento SDRAM
•   sincronizzazione orologio selezionabile di diverse interfacce
•   spegnimento dei servizi PCIe, SGMII, USB e SATA
•   Ethernet a risparmio energetico (EEE)
•   varie opzioni di sveglia

2 interfacce I2C
•   Porte master/slave I2C per impieghi generali
•   supporto inizializzazione seriale EEPROM

Orologio in tempo reale
•   attivazione del sistema esterno
•   batteria di backup

BootROM integrato
•   Avvio da Flash (SPI, NOR parallelo, NAND parallelo, NAND seriale (SPI-NAND) e   SDIO / MMC / eMMC)
•   Avvio da PCIe o SATA
•   flusso del bagagliaio protetto

2 Controller LDO (Low Drop out) integrato
•   controller LDO on-chip per transistor esterni positivo-negativo-positivo (PNP)
•   tensioni di uscita programmabili di 1.8/2,5V con risoluzione di 50 mV.

Pin multiuso (MPP)
•   88F6810/88F6820/88F6828 -60 pin MPP dedicati per funzioni periferiche e   Generale I/O PER USO (GPIO)
•   88F6811/88F6W21/88F6821 -48 pin MPP dedicati per funzioni periferiche e   Generale I/O PER USO (GPIO)
•   ciascun pin configurabile indipendentemente
•   ingressi GPIO configurabili per registrare interrupt da dispositivi esterni e generare   interrupt mascherabili
•   uscite GPIO configurabili per il controllo PWM del LED o. funzionamento della ventola

Generazione di clock
•   generazione interna di clock CPU, clock core, clock SDRAM, clock RGMII/MII,   clock SERDES, Orologio TDM, orologio audio e orologio di riferimento esterno da   un singolo orologio di riferimento a 25 MHz
•   supporta la generazione interna di clock a spettro esteso su Sottosistema CPU   e interfaccia SDRAM

Interrupt
Controller di interruzione generico (GIC) compatibile CON ARM, versione 1

Sensore termico
Sensore termico on-die con interruzione di surriscaldamento

Timer/contatori e timer watchdog
Timer/contatori a 32/64 bit programmabili integrati e timer watchdog

Pacchetto
88F6810/88F6820/88F6828 -TFBGA contenitore 17x17 mm, passo sfera 0.8 mm
88F6811/88F6821/88F6W21 -TFBGA contenitore da 14x14 mm, passo sfera 0.65 mm
Marvell Technology, Inc   . È una società americana con sede a   Santa Clara, California , che sviluppa e produce   semiconduttori   e tecnologie correlate. Fondata nel 1995, la società aveva più di 6,000 dipendenti al 2023, con oltre 10,000 brevetti in tutto il mondo, e un fatturato annuo di 4.5 miliardi di dollari per il 2023.


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Marvell Armada 38X Family 88f6828b0-BRT4kit High-Performance Dual CPU System on Chip
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  Q2 .quale certificazione avete ottenuto?

 A2  : il nostro prodotto utilizza rigorosamente il sistema di controllo qualità ISO9001:2008 e abbiamo superato il test CE, FCC, ROHS e SGS, potete fidarvi di noi.

 

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  A3 : Non è necessario preoccuparsi del pacchetto, per la consegna utilizzeremo una custodia antiurto.

 

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A5 :vi diamo la promessa se qualsiasi domanda durante 1 anno e non causa da fattori umani, noi la risolveremo.


 

 

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GOUV.NE, 2023