Beschreibung
ENC28J60-I/SO
:
Ethernet CTLR Single Chip 10Mbps 3,3V 28-polige SOIC W Tube
Mfr. TEIL#:
ENC28J60-I/SO
MFR.: MICROCHIP
Datenblatt:
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ROHS-Status:
Qualität: 100% Original
Garantie: EIN JAHR
Montageart:
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SMD/SMT
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Paket/Karton:
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SOIC-Wide-28
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Produkt:
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Ethernet-Controller
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Standard:
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10BASE-T
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Anzahl der Transceiver:
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1 Sender/Empfänger
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Datenrate:
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10 MB/s
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Schnittstellentyp:
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MII, MIIM, SPI
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Betriebsspannung:
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3,3 V
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Minimale Betriebstemperatur:
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- 40 C
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Maximale Betriebstemperatur:
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+ 85 C
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Serie:
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ENC28J60
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Verpackung:
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Rohr
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Marke:
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Microchip-Technologie
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Duplex:
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Vollduplex, Halbduplex
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Höhe:
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2,05 mm
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Länge:
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17,9 mm
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Feuchtigkeitsempfindlich:
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Ja
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Produkttyp:
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Ethernet-ICs
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Menge Der Werkseitigen Verpackung:
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27
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Unterkategorie:
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Kommunikations- und Netzwerk-ICs
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Versorgungsstrom - Max.:
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180 mA
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Breite:
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7,5 mm
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Gewicht Des Geräts:
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0,027937 oz
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Der ENC28J60 ist ein eigenständiger Ethernet-Controller mit einem SPI (Serial Peripheral Interface) nach Industriestandard. Es ist als Ethernet-Netzwerkschnittstelle für jeden Controller mit SPI konzipiert. Die ENC28J60 erfüllt alle IEEE 802,3-Spezifikationen. Es enthält eine Reihe von Paketfilterschemata, um eingehende Pakete zu begrenzen. Es bietet auch ein internes DMA-Modul für schnellen Datendurchsatz und hardwareunterstützte Prüfsummenberechnung, das in verschiedenen Netzwerkprotokollen verwendet wird. Die Kommunikation mit dem Host-Controller erfolgt über einen Interrupt-Pin und das SPI mit Taktraten von bis zu 20 MHz. Zwei dedizierte Pins werden für die LED-Verbindung und die Anzeige der Netzwerkaktivität verwendet
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Ethernet-Controller-Funktionen
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IEEE 802.3ô-kompatibler Ethernet-Controller
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Vollständig kompatibel mit 10/100/1000Base-T-Netzwerken
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Integrierte MAC- und 10Base-T PHY-Funktion
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Unterstützt einen 10Base-T-Port mit automatischer Polaritätserkennung und -Korrektur
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Unterstützt den voll- und Halbduplex-Modus
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Programmierbare automatische erneute Übertragung bei Kollision
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Programmierbare Padding- und CRC-Generierung
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Programmierbare automatische Ablehnung fehlerhafter Pakete
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SPI-Schnittstelle mit Taktraten bis zu 20 MHz Puffer
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8 kByte Sende-/Empfangspaket mit zwei Ports SRAM
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Konfigurierbare Größe Des Übertragungs-/Empfangspuffers
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Hardware Managed Circular Receive FIFO
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Byte-weiter Random- und Sequential Access mit Auto-Inkrement
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Interne DMA für schnelle Datenverschiebung
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Hardwareunterstützte Prüfsummenberechnung für verschiedene Netzwerkprotokolle mit mittlerem Zugriff Controller (MAC)-Funktionen
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Unterstützt Unicast-, Multicast- und Broadcast-Pakete
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Programmierbare Empfangspaketfilterung und Wake-up-Host auf logischen UND oder ODER der folgenden Optionen: - Unicast-Zieladresse - Multicast-Adresse - Broadcast-Adresse - Magic Packetô - Gruppen-Zieladressen gemäß 64-Bit Hash-Tabelle - Programmierbares Pattern-Matching von bis zu 64 Bytes bei benutzerdefinierten Offset Physical Layer (PHY)-Funktionen
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Loopback-Modus
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Zwei programmierbare LED-Ausgänge für LINK, TX, RX, Kollision und voll-/Halbduplex-Status
Warum wir uns entscheiden
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